To File

将数据写入到文件

库：
Simulink / Sinks
HDL Coder / Sinks

说明

To File 模块将输入信号数据写入 MAT 文件。此模块以增量方式写入到输出文件中，在仿真期间的内存开销极少。如果仿真开始时已经存在输出文件，模块将覆盖该文件。暂停仿真或仿真完成时，文件会自动关闭。如果仿真异常终止，To File 模块将保存它在异常终止时间点之前记录的数据。

To File 模块图标会显示输出文件的名称。

控制保存的数据量

如果使用 Configuration Parameters > Data Import/Export > Logging intervals 参数指定数据记录间隔，则 To File 模块仅记录时间间隔内的数据。例如，如果时间间隔为空 ([])，模块则不会记录任何数据。此模块将记录的数据存储在与模块关联的文件中，而不是存储在您为 Single simulation output 参数指定的变量中。

对于可变步长求解器，要控制 To File 模块可用的数据量，请使用 Configuration Parameters > Data Import/Export > Additional parameters > Output options 参数。例如，要在多次仿真的相同时间点写入数据，请选择 Produce specified output only 选项。

模块参数还控制保存的数据量。请参阅Decimation, DecimationDecimationDecimation和Sample time, Sample timeSample timeSample time。

暂停仿真

暂停仿真后，不要更改 To File 模块记录的任何文件。例如，不要使用 MATLAB^® save 命令保存此类文件。更改文件可能会导致恢复仿真时出现错误。如果要在暂停后更改文件，请复制文件并使用文件副本。

如果通过仿真步进器暂停，To File 模块将捕获暂停时间点之前的仿真数据。当您步退时，To File 数据文件将不再包含上次输出在减少时间之后的任何仿真数据。

限制

当引用模型中包含 To File 模块时，模型必须为单实例模型。模型架构中只能存在此模型的一个实例。有关详细信息，请参阅模型重用。

端口

输入

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`Port_1` - 输入信号
标量 | 向量 | 矩阵 | N 维数组

要存储在文件中的信号。每个采样都包含时间戳和相关数据值。数据可以是数组格式或 MATLAB timeseries 格式。To File 模块接受 Simulink^® 软件支持的任何数据类型的实信号或复信号数据，但字长超过 32 位的定点数据除外。

参数

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`File name` - 路径或文件名
`untitled.mat` （默认） | MAT 文件路径或名称

指定用来存储输出的 MAT 文件的路径名或文件名。在 UNIX^® 系统中，路径名称可以用波浪号字符 (~) 开头（该符号表示主文件夹）。如果指定的文件名没有路径信息，Simulink 软件会将文件存储在 MATLAB 工作文件夹中。（要确定工作文件夹，请在 MATLAB 命令行输入 pwd。）如果文件存在，Simulink 软件将覆盖它。

编程用法

模块参数：FileName

类型：字符向量

值：MAT 文件路径或名称

默认值：'untitled.mat'

`Variable name` - 矩阵名称
`ans` （默认） | 字符向量

指定文件中包含的矩阵的名称。

编程用法

模块参数：MatrixName

类型：字符向量

值：字符向量

默认值：'ans'

`Save format` - 数据格式
“`Timeseries`” （默认） | “`Array`”

指定 To File 模块写入数据所使用的数据格式。

“Array” 格式仅用于向量、双精度、非复信号。

对于 “Timeseries” 格式，To File 模块：

将数据写入到 MATLAB timeseries 对象中。
支持写入多维、实数或复数输出值。
支持写入任何内置数据类型的输出值，包括 Boolean、枚举 (enum) 和字长最多 32 位的定点数据。
对于虚拟和非虚拟总线输入信号，创建与总线架构匹配的 MATLAB 结构体。结构体的每个叶是一个 MATLAB timeseries 对象。

对于 “Array” 格式，To File 模块：

将数据写入到包含两行或多行的矩阵中。矩阵形式如下：

$[\begin{matrix} t_{1} & t_{2} & \dots & t_{f i n a l} \\ u 1_{1} & u 1_{2} & \dots & u 1_{f i n a l} \\ \dots \\ u n_{1} & u n_{2} & \dots & u n_{f i n a l} \end{matrix}]$
Simulink 软件在矩阵中为每个数据采样写入一列。列中的第一个元素包含时间戳。列的其余部分包含对应输出值的数据。
支持写入一维、双精度和非复数数据。

From File 模块可使用 To File 模块以任何格式（Timeseries 或 Array）写入的数据，无需对数据进行任何修改，也没有其他特殊配置。

From Workspace 模块可读取 Array 格式的数据，以及 To File 模块写入的数据的转置数据。要提供所需的格式，请使用 MATLAB 命令从 MAT 文件中加载并转置数据。

下表显示了不同 Save format 值对仿真模式的支持情况。

仿真模式	“`Timeseries`”	“`Array`”
Normal	支持	支持
Accelerator	支持	支持
Rapid Accelerator	支持	支持
软件在环 (SIL)	不支持	如果启用 MAT 文件日志记录，则支持。
处理器在环 (PIL)	不支持	如果 MAT 文件日志记录可用并且已启用，则支持。
外部	不支持	如果启用 MAT 文件日志记录，则支持。
RSim 目标	支持	如果启用 MAT 文件日志记录，则支持。

编程用法

模块参数：SaveFormat

类型：字符向量

值：'Timeseries' | 'Array'

默认值：'Timeseries'

`Decimation` - 确定数据写入时间的抽取因子
1 （默认） | 标量 | 向量

指定抽取因子 n，它在模块每执行 n 次时写入数据。默认值使此模块在每个时间步写入数据。

编程用法

模块参数：Decimation

类型：字符向量

值：标量 | 向量

默认值：'1'

`Sample time` - 采样期间和偏移量
-1 （默认） | 标量 | 向量

指定采集数据点的采样期间和偏移量。使用时间步间隔不是常量的可变步长求解器时，此参数很有用。默认值使此模块继承驱动模块的采样时间。请参阅指定采样时间。

编程用法

模块参数：SampleTime

类型：字符向量

值：标量 | 向量

默认值：'-1'

模型示例

Output Simulation Data with Blocks

How To Workspace and To File blocks write data to the workspace and to a file respectively.

打开脚本

模块特性

数据类型	`Boolean` \| `bus` \| `double` \| `enumerated` \| `fixed point^[a]` \| `integer` \| `single`
直接馈通	`否`
多维信号	`是`
可变大小信号	`否`
过零检测	`否`
^[a] 最高支持 32 位定点数据类型。

提示

当您在包含很多时间步的长时间仿真中记录很多信号时，如果 MATLAB 遇到内存问题，请考虑记录到持久存储。当您记录到持久存储时，Dataset 格式的记录数据将存储在 MAT 文件中。与记录到持久存储相比，为信号连接 To File 模块具有以下缺点：
- 它是一种逐信号处理方法，每个信号上可能会连接多个 To File 模块，从而使模型变得杂乱无序。
- 它会为每个 To File 模块创建一个单独的 MAT 文件，而记录到持久存储只使用一个 MAT 文件。
有关详细信息，请参阅Log Data to Persistent Storage。
为了避免实时压缩数据产生的开销，To File 模块将数据写入到未压缩的 7.3 版 MAT 文件中。要压缩 MAT 文件中的数据，请在 MATLAB 中加载并保存该文件。重新保存的文件比 To File 模块创建的原始 MAT 文件小，因为 Save 命令会压缩 MAT 文件中的数据。

扩展功能

C/C++ 代码生成
使用 Simulink® Coder™ 生成 C 代码和 C++ 代码。

不建议用于生产代码。涉及到嵌入式系统中常见的资源限制以及对速度和内存的限制。生成的代码可以包含动态分配和释放内存、递归、额外的内存开销以及长短不等的执行时间。虽然代码在功能上有效并且在资源丰富的环境中通常可接受，但较小的嵌入式目标通常不能支持此类代码。通常情况下，模块会向适合生产代码的方向发展。因此，适合生产代码的模块仍然适用。

RSim 目标的代码生成提供与 Simulink 相同的支持；所有其他代码生成目标仅支持具有时间格式的数组中的一维双精度实信号。

要为 To File 模块生成代码，请在 Code Generation > Interface 窗格中选择配置参数 MAT 文件日志记录 (Simulink Coder)。

HDL 代码生成
使用 HDL Coder™ 为 FPGA 和 ASIC 设计生成 Verilog 代码和 VHDL 代码。

当与生成 HDL 代码的子系统结合使用时，此模块可用于将仿真结果写入文件，但它不包括在硬件实现中

PLC 代码生成
使用 Simulink® PLC Coder™ 生成结构化文本代码。

定点转换
使用 Fixed-Point Designer™ 设计和仿真定点系统。

支持多达 32 位的定点数据类型。

另请参阅

From File | From Workspace | To Workspace

主题

在 R2006a 之前推出

To File

说明

控制保存的数据量

暂停仿真

限制

端口

输入

`Port_1` - 输入信号
标量 | 向量 | 矩阵 | N 维数组

参数

`File name` - 路径或文件名
`untitled.mat` （默认） | MAT 文件路径或名称

编程用法

`Variable name` - 矩阵名称
`ans` （默认） | 字符向量

编程用法

`Save format` - 数据格式
“`Timeseries`” （默认） | “`Array`”

编程用法

`Decimation` - 确定数据写入时间的抽取因子
1 （默认） | 标量 | 向量

编程用法

`Sample time` - 采样期间和偏移量
-1 （默认） | 标量 | 向量

编程用法

模型示例

Output Simulation Data with Blocks

模块特性

提示

扩展功能

C/C++ 代码生成
使用 Simulink® Coder™ 生成 C 代码和 C++ 代码。

HDL 代码生成
使用 HDL Coder™ 为 FPGA 和 ASIC 设计生成 Verilog 代码和 VHDL 代码。

PLC 代码生成
使用 Simulink® PLC Coder™ 生成结构化文本代码。

定点转换
使用 Fixed-Point Designer™ 设计和仿真定点系统。

另请参阅

主题

Simulink 文档

支持

Model-Based Design for Embedded Control Systems

To File

说明

控制保存的数据量

暂停仿真

限制

端口

输入

Port_1 - 输入信号 标量 | 向量 | 矩阵 | N 维数组

参数

File name - 路径或文件名 untitled.mat （默认） | MAT 文件路径或名称

编程用法

Variable name - 矩阵名称 ans （默认） | 字符向量

编程用法

Save format - 数据格式 “Timeseries” （默认） | “Array”

编程用法

Decimation - 确定数据写入时间的抽取因子 1 （默认） | 标量 | 向量

编程用法

Sample time - 采样期间和偏移量 -1 （默认） | 标量 | 向量

编程用法

模型示例

Output Simulation Data with Blocks

模块特性

提示

扩展功能

C/C++ 代码生成 使用 Simulink® Coder™ 生成 C 代码和 C++ 代码。

HDL 代码生成 使用 HDL Coder™ 为 FPGA 和 ASIC 设计生成 Verilog 代码和 VHDL 代码。

PLC 代码生成 使用 Simulink® PLC Coder™ 生成结构化文本代码。

定点转换 使用 Fixed-Point Designer™ 设计和仿真定点系统。

另请参阅

主题

Simulink 文档

支持

Model-Based Design for Embedded Control Systems

WeChat

`Port_1` - 输入信号
标量 | 向量 | 矩阵 | N 维数组

`File name` - 路径或文件名
`untitled.mat` （默认） | MAT 文件路径或名称

`Variable name` - 矩阵名称
`ans` （默认） | 字符向量

`Save format` - 数据格式
“`Timeseries`” （默认） | “`Array`”

`Decimation` - 确定数据写入时间的抽取因子
1 （默认） | 标量 | 向量

`Sample time` - 采样期间和偏移量
-1 （默认） | 标量 | 向量

C/C++ 代码生成
使用 Simulink® Coder™ 生成 C 代码和 C++ 代码。

HDL 代码生成
使用 HDL Coder™ 为 FPGA 和 ASIC 设计生成 Verilog 代码和 VHDL 代码。

PLC 代码生成
使用 Simulink® PLC Coder™ 生成结构化文本代码。

定点转换
使用 Fixed-Point Designer™ 设计和仿真定点系统。