快速入门

探索混合信号系统示例、视频和教程。

第 1 阶段：混合信号建模简介
Mixed-Signal Blockset 概述
Mixed-Signal Blockset 可用来设计和仿真模拟信号系统和混合信号系统，如 ADC 和 PLL。

视频
SerDes Toolbox 概述
使用 SerDes Toolbox 设计 SerDes 系统，并为高速互联（例如 DDR、PCI Express 和以太网）生成 IBIS-AMI 模型。

视频
Simscape Electrical 概述
使用 Simscape Electrical 对电子、机电和电力系统进行建模和仿真。

视频
HDL Coder 概述
HDL Coder 通过生成 Verilog 和 VHDL 代码支持 FPGA、SoC 和 ASIC 的高层设计。您可以将生成的 HDL 代码用于 FPGA 编程、ASIC 原型构建和产品级设计。

视频
使用规格书进行 PLL 设计和验证（包含相位噪声）
使用 Mixed-Signal Blockset 为商用整数分频 PLL 建模，其工作频率约为 4GHz，采用双模预分频器。验证 PLL 性能，包括相位噪声、锁定时间和工作频率。

视频
用于汽车传感器的基于模型的混合信号设计流程
Allegro Microsystems 进行了分享，介绍如何利用 MATLAB 和 Simulink 进行快速原型设计、简化基于 UVM 的验证过程，以及针对混合信号传感器 IC 自动生成 RTL 代码。

视频

Mixed-Signal Blockset 模型
Mixed-Signal Blockset 模型
Mixed-Signal Blockset 模型可提供典型系统（例如 PLL、ADC、SerDes 和 SMPS 突出模拟/数字集成）的更多模型和示例。

附加功能

设计和评估简单 PLL 模型
设计和评估简单 PLL 模型
此示例说明如何使用参考架构设计简单 PLL，并使用 PLL 测试平台验证 PLL。

文档

Flash ADC 中的亚稳态损伤效应
Flash ADC 中的亚稳态损伤效应
此示例说明如何通过添加亚稳态可能性作为损伤来定制 flash ADC，以及如何衡量上述损伤。

文档

第 2 阶段：使用 Simscape 进行模拟建模
Simscape Electrical 中的应用和任务
通过 Simscape Electrical 来设计机电系统机电作动器和混合电动汽车体现了仿真在设计流程中的价值所在。

视频
实时仿真：电动作动器
将机电作动器模型转换为 C 代码并将其用于硬件在环仿真。在实时目标上调节 Simscape 参数。

视频

切换式电容模数转换器
切换式电容模数转换器
此示例介绍 sigma-delta ADC（模数转换器）如何使用 sigma-delta 调制将模拟输入信号转换为数字输出信号。

示例

使用 Simscape 为物理系统建模
使用 Simscape 为物理系统建模
本课程为期一天，重点介绍如何在 Simulink 环境中使用 Simscape 对多个物理域中的系统进行建模并将其组合成多域系统。

收费培训

第 3 阶段：通过 HDL 代码生成进行数字设计
使用 MATLAB 进行 FPGA 设计 (5 个视频)
该视频指南包含五个部分，可帮助您了解如何使用 MATLAB 进行 FPGA 设计。探索面向 FPGA 或 ASIC 目标硬件设计信号处理算法时需要考虑的关键因素。

视频
生成用于 FPGA 和 ASIC 硬件的浮点 HDL
直接从单精度、双精度或半精度浮点模型生成不依赖于特定目标的、可综合的 VHDL 或 Verilog 代码。

视频
在 FPGA 编程中轻松运用定点
了解定点数学背后的基本概念，以及如何运用这些知识在 FPGA 硬件上高效实现您的设计。

视频

Instructor-Led Training

DSP FPGA
面向 FPGA 的数字信号处理 (DSP)
本课程为期三天，将从 FPGA 结构内实现的角度回顾 DSP 基础知识。

Instructor-Led Training

第 4 阶段：混合信号验证概述
什么是 HDL Verifier
使用 HDL Verifier 测试和验证 FPGA、ASIC 和 SoC 设计。借助与 HDL 仿真器的协同仿真，使用 MATLAB 或 Simulink 中的测试平台验证 RTL。结合使用这些测试平台和开发板来验证硬件中的 HDL 实现。

视频
生成 SystemVerilog DPI 以进行模拟混合信号验证
将混合信号 Simulink 模型导出到 SystemVerilog 仿真器中。

视频
导入 HDL 以使用 Simulink 进行协同仿真
使用 HDL Verifier 导入手写或旧版 VHDL 或 Verilog，以与 Simulink 进行协同仿真。

视频
SPICE 模型与 Cadence Spectre 协同仿真
为您的设计采用 HDL Coder 的快速入门指南，含所选概念的示例说明。

视频
利用 MATLAB 和 Simulink 进行 PLL 设计
PLL 仿真通常较慢，会拖长项目开发时间。为了加快 PLL 设计速度，工程师们会采用 MathWorks 工具。这些工具能够根据反馈高效建模、可让模拟和数字组件同时仿真，而且还具备抽象

视频

构建 QAM 收发器模型的 HDL 测试平台
构建 QAM 收发器模型的 HDL 测试平台
此示例展示如何通过生成 SystemVerilog DPI-C 组件来构建行为测试平台。 示例

示例

持续支持

技术研讨会

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